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Layout-Design Methodology of 0.246-¿m 2 -Embedded 6T-SRAM for 45-nm High-Performance System LSIs
S Taniguchi, Tetsuo Fujimaki, Hiroyuki Yamada,Naoki Nagashima,F Matsuoka,T Kuwata,M Saito,Hisashi Inokuma,Shinichi Yamada,Kei Imai,Yukinori Enomoto,Hiroshi Naruse, Toyokazu Kitano,Masayuki Iwai,Manabu Ikeda,Toshiko Hirai, Hiroo Maeda, Katsuya Oshima, Ritsuo Watanabe,Hiroshi Fukui, Y Tsunoda,Mitsuhiro Togo, Saori Kanai,S Shino, Teruhiko Hoshino,K Shimazaki,Masataka Nakazawa,Kazuhiro Nakazawa,Yoko Takasu, Hiro Yamasaki, Kazumasa Sunouchi, Keiko Yoshida,Kazuhisa Ohno,Yu Sogo,Hideaki Nii, T Iwamoto,Shoji Mimotogi, Kei Nagaoka,S Iwasa,S Muramatsu, Shinro Watanabe,R Morimoto,Tetsuya Kimura,Yoshimichi Okayama
mag（2007）
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Layout-Design Methodology of 0.246-¿m<sup>2</sup>-Embedded 6T-SRAM for 45-nm High-Performance System LSIs
R. Morimoto,T. Kimura,Y. Okayama, T. Hirai, H. Maeda, K. Oshima, R. Watanabe, H. Fukui, Y. Tsunoda,M. Togo, S. Kanai,S. Shino, T. Hoshino,K. Shimazaki,M. Nakazawa, K. Nakazawa, Y. Takasu, H. Yamasaki,H. Inokuma, S. Taniguchi, T. Fujimaki, H. Yamada, S. Watanabe,S. Muramatsu,S. Iwasa,K. Nagaoka,S. Mimotogi, T. Iwamoto,H. Nii,Y. Sogo, K. Ohno, K. Yoshida,K. Sunouchi, M. Ikeda,M. Iwai, T. Kitano, H. Naruse,Y. Enomoto, K. Imai,S. Yamada,M. Saito,T. Kuwata,F. Matsuoka,N. Nagashima
2007 IEEE Symposium on VLSI Technology (2007)
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