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FOSS CAD for the Compact Verilog-A Model Standardization in Open Access PDKs
Wladek Grabinski, Rene Scholz,Jason Verley,Eric R. Keiter, Holger Vogt, Dietmar Warning,Paolo Nenzi,Francesco Lannutti,Felix Salfelder, Al Davis,Mike Brinson, Bal Virdee,Guilherme Torri,Daniel Tomaszewski',Matthias Bucher,Jean -Michel Sallese,Markus Mueller,Pascal Kuthe,Mario Krattenmacher
8TH IEEE ELECTRON DEVICES TECHNOLOGY & MANUFACTURING CONFERENCE, EDTM 2024pp.646-648, (2024)
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Xyce Circuit Simulator and Surrogate Modeling
Eric Keiter,Jason Verley,Heidi Thornquist,Paul Kuberry, Edgar Galvan
Proposed for presentation at the DARPA Electronics Resurgence Initiative (ERI) Summit &amp Microsystems Technology Office (MTO) Symposium held October 19-21, 2021 in , (2021)
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