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A 4.13-Ghz UHS Pseudo Two-Port SRAM with BL Charge Time Reduction and Flying Word-Line for HPC Applications in 4-Nm FinFET Technology
Jeongkyun Kim,Byungho Yook, Youngo Lee,Taemin Choi, Kyuwon Choi, Chanho Lee, Juchang Lee,Hyeongcheol Kim, Seok Yun, Changhoon Do, Minwoo Kwak, Mijoung Kim,Yunrong Li,Hoyoung Tang, Jaeyoung Kim,Inhak Lee,Dongwook Seo,Sangyeop Baeck
IEEE JOURNAL OF SOLID-STATE CIRCUITSno. 4 (2024): 1216-1224
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A 4.0GHz UHS Pseudo Two-port SRAM with BL Charge Time Reduction and Flying Word-Line for HPC Applications in 4nm FinFET Technology
Jeongkyun Kim,Byungho Yook,Taemin Choi, Kyuwon Choi, Chanho Lee,Yunrong Li, Youngo Lee, Seok Yun, Changhoon Do,Hoyoung Tang,Inhak Lee,Dongwook Seo,Sangyeop Baeck
VLSI Technology and Circuitspp.1-2, (2023)
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Spike Counts Based Low Complexity SNN Architecture With Binary Synapse
Hoyoung Tang,Heetak Kim, Hyeonseong Kim,Jongsun Park
IEEE Transactions on Biomedical Circuits and Systemsno. 6 (2019): 1664-1677
引用31浏览0WOSEI引用
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